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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 538 |
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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 10 | 7 | 7 | 2 | 20 | 12 | 2 |
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| Rafael de Figueredo Viana_.pdf | 291 |
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| Brazil | 538 |
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