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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 424 |
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| Design and simulation of a RISC-V dual-core lockstep for fault tolerant systems | 6 | 7 | 3 | 5 | 11 | 13 | 0 |
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| Rafael de Figueredo Viana_.pdf | 245 |
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| Brasil | 424 |
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